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risc_v [2019/03/18 12:56]
gongyu 创建 		risc_v [2019/09/05 14:18] (当前版本)
gongyu
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-RISC-V（发音为“risk-five”）是基于已建立的精简指令集计算机（RISC）原理的开源硬件指令集架构（ISA）。该项目于2010年在加州大学伯克利分校开始，但许多贡献者都是不隶属于该大学的志愿者。截至2019年3月，用户空间ISA版本2.2被冻结，允许大多数软件开发继续进行。 特权ISA可作为草案版本1.10使用。 调试规范可用作草案版本0.13.1。+RISC-V（发音为“risk-five”）是基于已建立的精简指令集计算机（RISC）原理的开源硬件指令集架构（ISA）。该项目于2010年在加州大学伯克利分校开始，但许多贡献者都是不隶属于该大学的志愿者。2019年3月，用户端的版本2.2的ISA固定下来，大多数软件开发者可以继续进行开发。 特许模式的ISA的草案版本1.10可以使用。 调试规范可用作草案版本0.13.1。 
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-===== 意义 ===== +===== RISC-V对行业的意义 ===== 
-可用的新ISA通常非常昂贵。计算机设计师通常无法免费工作。此外，开发CPU需要几个专业的设计专业知识：电子数字逻辑，编译器和操作系统。在专业工程组织之外找到这样一个团队是很少见的。团队通常是从他们的设计收取的钱中支付的。因此，计算机设计的商业供应商，如ARM Holdings和MIPS Technologies，就其设计，专利和版权的使用收取使用费。+可用的新指令集架构（ISA）通常非常昂贵，计算机设计师通常无法免费工作。此外，开发CPU需要几个专业的设计专业知识：电子数字逻辑、编译器和操作系统。在专业工程组织之外找到这样一个团队是不容易的。团队通常是从他们的设计收取的钱中支付的。因此，计算机设计的商业供应商，如ARM Holdings和MIPS Technologies，就其设计，专利和版权的使用收取使用费。
  
 在发布描述其设计详细优势和指令集的文档之前，他们还经常要求保密协议。在许多情况下，他们从未描述他们的设计选择的原因。 在发布描述其设计详细优势和指令集的文档之前，他们还经常要求保密协议。在许多情况下，他们从未描述他们的设计选择的原因。
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 RISC-V的硬件辅助调试器有一个初步规范。调试器将使用传输系统（如联合测试操作组（JTAG）或通用串行总线（USB））来访问调试寄存器。标准的硬件调试接口可以支持标准化的抽象接口或指令馈送。 RISC-V的硬件辅助调试器有一个初步规范。调试器将使用传输系统（如联合测试操作组（JTAG）或通用串行总线（USB））来访问调试寄存器。标准的硬件调试接口可以支持标准化的抽象接口或指令馈送。
  
-截至2017年1月，抽象接口的确切形式仍未定义，但提案包括一个内存映射系统，其中包含调试设备寄存器的标准化地址或命令寄存器和通信系统可访问的数据寄存器。记者声称飞思卡尔的后台调试模式接口（BDM）对某些CPU，ARM，OpenRISC和Aeroflex的LEON使用了类似的系统。+截至2017年1月，抽象接口的确切形式仍未定义，但提案包括一个内存映射系统，其中包含调试设备寄存器的标准化地址或命令寄存器和通信系统可访问的数据寄存器。客户声称飞思卡尔的后台调试模式接口（BDM）对某些CPU，ARM，OpenRISC和Aeroflex的LEON使用了类似的系统。
  
-在指令馈送中，CPU将处理调试异常以执行写入寄存器的各个指令。这可以通过数据传递寄存器和直接访问存储器的模块来补充。指令馈送使调试器能够像软件一样访问计算机。它还可以最大限度地减少CPU的变化，并适应多种类型的CPU。据说这对RISC-V特别适用，因为它是为许多类型的计算机明确设计的。数据传递寄存器允许调试器将数据移动循环写入RAM，然后执行循环以便以接近调试系统数据通道最大速度的速度将数据移入或移出计算机。记者表示，MIPS科技MIPS，英特尔夸克，Tensilica的Xtensa以及飞思卡尔Power ISA CPU的后台调试模式接口（BDM）使用了类似的系统。+在指令馈送中，CPU将处理调试异常以执行写入寄存器的各个指令。这可以通过数据传递寄存器和直接访问存储器的模块来补充。指令馈送使调试器能够像软件一样访问计算机。它还可以最大限度地减少CPU的变化，并适应多种类型的CPU。据说这对RISC-V特别适用，因为它是为许多类型的计算机明确设计的。数据传递寄存器允许调试器将数据移动循环写入RAM，然后执行循环以便以接近调试系统数据通道最大速度的速度将数据移入或移出计算机。客户表示，MIPS科技的MIPS，英特尔的Quark，Tensilica的Xtensa以及飞思卡尔Power ISA CPU的后台调试模式接口（BDM）使用了类似的系统。